基于FPGA的宽带ADC采集系统的设计与实现
发布时间：2017-06-09 01:00
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【摘要】：针对宽带采集系统设计中的时钟抖动、高速ADC电路、高速数据缓存和高速数据传输等问题,阐述了一种基于FPGA为主控芯片、DDRII作为缓存模块、采样速率为500 MHz的宽带ADC数据采集系统的设计与实现。分析了各部分对采集系统的影响和在设计中需要注意的问题。对设计的系统进行了性能测试。
【作者单位】： 中国船舶重工集团公司第七二四研究所;
【关键词】： 雷达 信号处理 FPGA 采集系统 ADC
【分类号】：TN79;TP274.2
【正文快照】： 0引言雷达瞬时工作带宽的扩展可获得复杂目标的精细回波,因而也有效提高了雷达距离分辨力。因此,针对宽带雷达的宽带采集技术也越来越受到关注。宽带采集系统的关键技术在于最大时钟抖动的确定、高速ADC电路的设计、高速数据的缓存以及高速数据的传输。本文针对这些问题,设计
【参考文献】
中国期刊全文数据库 前2条
1 丁家会;数字化接收机极限性能指标的研究[J];现代雷达;2005年09期
2 邱兆坤,王伟,马云,陈曾平;一种新的高分辨率ADC有效位数测试方法[J];国防科技大学学报;2004年04期
【共引文献】
中国期刊全文数据库 前10条
1 李赛辉;刘剑;蒋^
本文编号：434064
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