基于FPGA的双端口视频缓冲器设计

发布时间：2018-02-03 22:50

  本文关键词： FPGA FIFO SDRAM控制器 仲裁器　出处：《液晶与显示》2014年04期 　论文类型：期刊论文

【摘要】：介绍一种基于FPGA和SDRAM的双端口的视频缓冲器设计方法。使用小容量的同步FIFO和异步FIFO串联构成用户接口,采用分块方式读写单块存储器SDRAM,采用混合算法合理仲裁读、写和刷新请求,实现单路视频数据的实时采集和输出。本系统设计简单,调试方便。只需适当地改变数据块的长度和FIFO的容量就可以应用于其他的视频处理系统。仿真测试结果表明:SDRAM时钟频率工作在71MHz下可以确保视频流的流畅性。而且通过改变FIFO的相关参数,还可以继续提高SDRAM的实际带宽。本设计还具有一定的灵活性。
[Abstract]:The paper introduces a video buffer design method of dual port FPGA and SDRAM based on the use of small capacity of synchronous and asynchronous FIFO FIFO series of user interface, the block read and write a single block of memory SDRAM, the hybrid algorithm reasonable arbitration read, write and refresh requests, real-time data acquisition and output of single channel video data. This system has the advantages of simple design, convenient debugging. Only appropriate to change the length of the data block and the capacity of FIFO can be applied to other video processing system. The simulation results show that: SDRAM clock work can ensure the smooth video stream in 71MHz. And the related parameters by changing the FIFO, can continue to improve the actual bandwidth of SDRAM. The design also has a certain degree of flexibility.

【作者单位】： 贵州财经大学信息学院;
【分类号】：TP333
【正文快照】： 1引言在多数的基于FPGA(Field ProgrammableGate Arrays)的视频处理系统中,通常需要使用片外大容量存储器SDRAM(SynchronousDynamic Random Access Memory)缓存海量视频资料[1-2]。同时为了确保视频流的流畅性,甚至使用多块SDRAM内存和大容量的FIFO(First In First Out)实现乒

【参考文献】

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【共引文献】

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【二级参考文献】

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本文编号：1488565