时钟共享多线程处理器存储结构的设计与实现

发布时间：2018-03-10 19:08

  本文选题：时钟共享多线程　切入点：处理单元　出处：《微电子学与计算机》2017年01期 　论文类型：期刊论文

【摘要】：针对时钟共享多线程处理器(SMT_PAAG)中指令和数据存取速率的需求,提出了一种时钟共享多线程处理器交叉存储结构.该结构分为数据交叉存储和指令交叉存储,其中数据交叉存储实现了前向处理单元和多线程处理单元(Processing Element,PE)的数据交互、线程间数据交互以及线程内部数据存取;指令交叉存储实现了PE内部线程的指令存取.在FPGA上实现结果表明,该交叉存储结构能够满足多线程处理器对于指令和数据存取速率的需求,最高工作频率可达518.309 MHz.
[Abstract]:In order to meet the requirement of instruction and data access rate in clock shared multithread processor (SMT-PAAGG), a clock sharing multithread processor cross-storage architecture is proposed, which is divided into data cross-storage and instruction cross-storage. The data cross storage realizes the data interaction between the forward processing unit and the multithread processing unit processing element PE), the data exchange between threads and the data access within the thread. Instruction cross storage realizes instruction access of inner thread of PE. The result on FPGA shows that the cross storage structure can meet the requirement of instruction and data access rate of multi thread processor, and the highest working frequency can reach 518. 309 MHz.
【作者单位】： 西安邮电大学电子工程学院;西安邮电大学计算机学院;
【分类号】：TP302

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本文编号：1594675