面向分组密码的可重构异构多核并行处理架构

发布时间：2018-04-01 12:26

  本文选题：分组密码　切入点：异构多核　出处：《电子学报》2017年06期

【摘要】：现有的可重构分组密码实现结构中,专用指令处理器吞吐率不高,阵列结构资源利用率低、算法映射过程复杂.为此,设计了分组密码可重构异构多核并行处理架构RAMCA(Reconfigurable Asymmetrical Multi-Core Architecture),分析了典型SP(AES-128)、Feistel(SMS4)、L-M(IDEA)及MISTY(KASUMI)结构算法在RAMCA上的映射过程.在65nm CMOS工艺下完成了逻辑综合和功能仿真.实验表明,RAMCA工作频率可达到1GHz,面积约为1.13mm2,消除工艺影响后,对各分组密码算法的运算速度均高于现有专用指令处理器以及Celator、RCPA和BCORE等阵列结构密码处理系统.
[Abstract]:In the existing reconfigurable block cipher architecture, the throughput of the special instruction processor is not high, the resource utilization of the array structure is low, and the algorithm mapping process is complex.In this paper, a reconfigurable heterogeneous multi-core parallel processing architecture, RAMCA(Reconfigurable Asymmetrical Multi-Core Architecture, is designed, and the mapping process of typical SPAES-128 / FeistelSMS4MMS4MMS4 / MIDEAA and MISTYYKASUMI) architecture algorithm on RAMCA is analyzed.Logic synthesis and function simulation are completed in 65nm CMOS process.The experimental results show that the frequency of RAMCA can reach 1 GHz and the area is about 1.13mm2.After eliminating the influence of technology, the operation speed of each block cipher algorithm is higher than that of the existing special instruction processor and the array cipher processing systems such as Celator RCPA and BCORE.
【作者单位】： 解放军信息工程大学;复旦大学专用集成电路与系统国家重点实验室;
【基金】：国家自然科学基金(No.61404175)
【分类号】：TP332

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本文编号：1695592