高性能SIMD乘法阵列体系结构

发布时间：2018-04-23 19:44

  本文选题：SIMD + 乘法　； 参考：《微电子学与计算机》2014年03期

【摘要】：描述了一种新型的高性能高能效SIMD乘法阵列的结构.该乘法阵列支持同时执行1个64位乘法,4个32位乘法或16个16位有符号/无符号乘法.通过修改乘法算法实现结构,提高了乘加单元的面积复用度,在较小的面积和性能开销下实现了上述功能.并引入了"溢出补偿技术"解决了复数矩阵乘法运算的判溢出问题.通过牺牲非关键路径上短位宽乘法性能,提高关键路径上高位宽乘法性能.所述结构与文献[1]中乘法簇结构相比,64位乘法延时减少3.65%,面积降低3.92%,功耗提高5.71%.
[Abstract]:The structure of a novel high performance and high energy efficiency SIMD multiplication array is described. The array supports 1 64 bit multiplication, 4 32 bit multiplication or 16 16 bit signed / unsigned multiplication. By modifying the structure of the multiplication algorithm, the area reuse degree of the multiplication and addition unit is improved, and the above functions are realized with small area and performance overhead. The spillover compensation technique is introduced to solve the problem of decision spillover of complex matrix multiplication. By sacrificing the performance of short bit width multiplication on non-critical path, the performance of high bit width multiplication on critical path is improved. Compared with the multiplicative cluster structure in reference [1], the proposed structure reduces the delay of 64-bit multiplication by 3.65, reduces the area by 3.92and increases the power consumption by 5.71.
【作者单位】： 国防科技大学计算机学院;
【基金】：国家自然科学基金项目“多核多线程DSP适应性存储结构研究”(61070036)
【分类号】：TP332.22

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本文编号：1793344