一种16位定点式DSP核的设计及Modelsim仿真验证
本文选题:DSP核 + 定点式 ; 参考:《微电子学与计算机》2014年06期
【摘要】:为提高DSP的工作效率,设计了一种4级流水线的16位定点式DSP核.分别从系统及关键模块设计两个方面,介绍了DSP核的具体设计方法,着重分析了流水线的实现方案及DSP核的指令流与数据流,给出了DSP核的完整设计方案.最后给出DSP核支持的指令集,并基于Modelsim仿真环境对指令集进行验证.结果表明,该DSP核能够正确执行各条指令,最高时钟频率为12.5MHz,可在单个机器周期内完成高速运算.
[Abstract]:In order to improve the efficiency of DSP, a 4-stage pipelined 16-bit fixed-point DSP kernel is designed. The design method of DSP core is introduced from two aspects of system and key module design. The implementation scheme of pipeline and the instruction flow and data flow of DSP core are analyzed emphatically. The complete design scheme of DSP core is given. Finally, the instruction set supported by DSP core is given, and the instruction set is verified based on Modelsim simulation environment. The results show that the DSP core can execute each instruction correctly, and the highest clock frequency is 12.5 MHz, which can complete high speed operation in a single machine cycle.
【作者单位】: 沈阳工业大学信息科学与工程学院;
【分类号】:TP332
【参考文献】
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【共引文献】
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1 陈芳s,
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