基于Load重用的低功耗数据Cache设计

发布时间：2018-05-02 18:27

  本文选题：Load重用 + 低功耗　； 参考：《微电子学与计算机》2014年06期

【摘要】：针对嵌入式处理器中数据Cache功耗显著的特点,提出了一种基于Load重用的低功耗数据Cache设计方法.通过保存Load指令从数据Cache中取回的数据,实现了随后Load指令对该数据的重新使用,从而减少了数据Cache的访问次数,有效降低了数据Cache的功耗.在SuperV_EF01DSP上的实验结果显示,采用该方法后,在处理器性能没有损失的情况下,数据Cache功耗平均降低29.48%,面积仅增加0.64%.
[Abstract]:Aiming at the significant power consumption of data Cache in embedded processor, a design method of low power data Cache based on Load reuse is proposed. By saving the data retrieved from the data Cache by the Load instruction, the reuse of the data by the subsequent Load instruction is realized, which reduces the number of access to the data Cache and effectively reduces the power consumption of the data Cache. The experimental results on SuperV_EF01DSP show that the data Cache power consumption is reduced by 29.48 and the area is only increased by 0.64 without loss of processor performance.
【作者单位】： 中国科学院大学;中国科学院声学研究所;
【基金】：国家“九七三”计划项目(2009CB320202)
【分类号】：TP332

【参考文献】

相关期刊论文 前2条

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【共引文献】

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相关博士学位论文 前2条

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【二级参考文献】

相关期刊论文 前4条

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2 黄海林;范东睿;许彤;朱鹏飞;郑保建;曹非;陈亮;;嵌入式处理器在片调试功能的设计与实现[J];计算机辅助设计与图形学学报;2006年07期

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【相似文献】

相关期刊论文 前10条

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4 周，

本文编号：1835000