FT-XDSP千兆以太网控制器物理编码子层单元设计与实现

发布时间：2018-05-07 14:10

  本文选题：以太网 + 物理编码子层　； 参考：《国防科学技术大学》2015年硕士论文

【摘要】：在当前电子设备日趋网络化时代,越来越多的电子设备要求具有联网功能。以太网作为最重要的网络通信技术之一,由于其具有结构简单、灵活、易扩展、可靠性高、实现成本低、软硬件资源丰富等诸多优点成为了当前众多嵌入式设备的首选。本文以国防科技大学自主开发的多核高性能微处理器FT-XDSP为依托,设计开发了FT-XDSP外设部件以太网接口控制器MAC模块的物理编码子层(physical coding sublayer,PCS)单元,使其能够正确地集成在MAC控制器中实现预定的功能。根据FT-XDSP物理编码子层单元的功能需求,对以太网体系结构相关协议进行了深入研究,本文主要完成了以下工作:1、根据物理编码子层单元要实现的功能需求对其进行了总体设计,并采用自顶向下的方法对物理编码单元进行了模块划分。划分后的物理编码子层单元包含了发送处理、接收处理、冲突检测、载波侦测、8B/10B编解码、自协商处理、同步检测等模块;2、在对每个单元实现原理以及实现过程充分掌握的基础上使用Verilog硬件描述语言对每个单元模块进行了功能描述;3、搭建了模块级以及系统级验证平台,制定了详细的验证计划,并对物理编码子层单元的各个功能点从模块级到系统级进行了全面验证,验证结果表明物理编码子层单元功能设计正确,并且集成在MAC控制器后能正常进行工作。4、在40nm工艺下,使用DC工具对物理编码子层单元进行了逻辑综合。综合后物理编码子层单元的面积为3409.223927,功耗为0.2251mw,最后达到500MHz设计指标。
[Abstract]:In this paper , the physical coding sublayer ( PCS ) unit of Ethernet interface controller MAC module is designed and developed based on the multi - core high - performance microprocessor FT - XDSP which is developed by National Defense Science and Technology University .

【学位授予单位】：国防科学技术大学
【学位级别】：硕士
【学位授予年份】：2015
【分类号】：TP332;TP393.11

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本文编号：1857233