基于流水化和滑动窗口结构的低功耗指令Cache设计

发布时间：2018-12-08 13:43

【摘要】：嵌入式处理器中Cache的应用极大地提高了处理器的性能,同时Cache,尤其是指令Cache功耗占据了处理器很大一部分功耗,关闭不必要的tag SRAM和data SRAM的访问,可以极大地降低功耗。提出了一种流水化的指令Cache访问机制,关闭不必要的data SRAM的访问;并且通过记录指令Cache行的信息和预测下一行的Cache形成一个Cache行滑动窗口,关闭不必要的tag SRAM访问。所提出的方法没有性能损失,在SMIC 90nm工艺下进行功耗分析,其指令访问的功耗降低50%。
[Abstract]:The application of Cache in embedded processor greatly improves the performance of the processor, and the power consumption of Cache, especially the instruction Cache, occupies a large part of the power consumption of the processor. Closing unnecessary access to tag SRAM and data SRAM can greatly reduce the power consumption. In this paper, a pipelined instruction Cache access mechanism is proposed to close unnecessary data SRAM access, and a Cache line sliding window is formed by recording the information of the instruction Cache line and predicting the next row Cache to close the unnecessary tag SRAM access. The proposed method has no performance loss, and the power consumption of instruction access is reduced by 50% in SMIC 90nm process.
【作者单位】： 西安微电子技术研究所;
【基金】：国家863计划资助项目(2011AA120201)
【分类号】：TP332

【参考文献】

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【共引文献】

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【二级参考文献】

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本文编号：2368460