JESD204B接口协议中的加扰电路设计

发布时间：2019-03-04 09:11

【摘要】：数据加扰有助于避免在高速串行传输中出现频谱杂散,对JESD204B协议规定的加扰电路进行了具体设计和实现。首先详细描述了协议要求,以8位并行加扰为例阐述了自同步加扰和解扰的电路原理,最后根据解扰器输出状态与初始状态值有关这一问题提出了改进的电路结构以及关键设计代码。仿真结果表明,该改进电路完全满足协议要求,可应用于JESD204B规范的高速串行接口电路设计。
[Abstract]:Data scrambling is helpful to avoid spectrum spurious in high-speed serial transmission. The scrambling circuit specified by JESD204B protocol is designed and implemented in detail. Firstly, the requirements of the protocol are described in detail, and the circuit principle of self-synchronous scrambling and descrambling is illustrated with 8-bit parallel scrambling as an example. Finally, according to the problem that the output state of the descrambler is related to the initial state value, the improved circuit structure and the key design code are presented. The simulation results show that the improved circuit meets the requirements of the protocol and can be applied to the design of high-speed serial interface circuit of JESD204B specification.
【作者单位】： 中国地质大学(武汉)机械与电子信息学院;
【分类号】：TP334.7

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本文编号：2434137