基于MPC8540的硬件平台开发
【图文】:
与每个作为内存的sDRAM的LDM,(U)DM连接的是MDM[0:7]中的两个,与DQS同理,与作为ECC的SDRAM的LDQs连接的是MDM[8]。与作为ECC的SDRAM由于它是8位数据进行交互,MPC只需要与SDRAM的LDQS,连接的是MDQ【8].DQS的作用是数据滤波。即确保输出读数据,输入写数据。对于x16模式,LDQs控制DQO一DQ7,(U)DQS控制DQS一DQ15。DM的作用是数据遮罩。即确保输出读数据,输入写数据。对于x16模式,,LDM控制DQo一DQ7,(U)DDM控制DQS一DQ15。刷新时间的计算方法如下:行刷新时间二(psRT+I)*(P仰+l冲usfreqbusfreq二66Mhz,PsRT=巧(十进制),P开=60(十进制),带入可得到行刷新时间二14.8us。而选择的SDRAM的要求是64ms/4096二15.6us,所以是可以满足芯片时序要求的。K4HS11638B的读写时序如下:<Burst比ngth叫甲CAS比加ncy吕2,2.5>
图3.6淤C8540与SDRAM连接原理图完全可编程DDRSDRAM控制器支持大部分第一代的JEDEC标准的x16的DDR内存,包括缓存的双列直插内存模块和非缓存的双列直插内
【学位授予单位】:北京邮电大学
【学位级别】:硕士
【学位授予年份】:2007
【分类号】:TP368.1
【共引文献】
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本文编号:2661391
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