基于UVM的CAN总线控制器的验证方法研究
【学位授予单位】:西安电子科技大学
【学位级别】:硕士
【学位授予年份】:2018
【分类号】:TP332.3;TN402
【图文】:
以便全面了解用户。就像使用 OVM 一样,一个以度量为导向的验证流程中实现的,该流程利试的功能和自动化来确保生产力。 验证平台组件结构当中,所有验证组件都是从这些基类派生的较、复制、打印和报告功能,这是 UVM 的核心功只有两个主要分支。一个是定义验证组件,如驱动验证组件消耗和操作的数据对象。所有测试平台派生,所有数据对象都应该从 uvm_sequence_item了序列的概念,这个概念是设计的实际激励的容中,它将增强重复使用的能力,并以随机顺序驱动证结果。UVM 验证平台结构图 2.5 所示:
图 4.4 interface 部分代码图接口中先后定义时钟 CLK 信号,复位 RST 信号,数据地址复用 AD 信号,片(低有效,读使能),RD(写使能,低有效),WR 地址锁定(下降沿有效),模择(MODE,1=intel 模式,0=motorala 模式)数据发送端口:TX0,TX1。数据端口:RX0,RX1。4.2.2 事务基类 transaction事务基类 transaction 的 CAN 总线验证平台当中传递数据的一部分,是一个抽概念,一般的数据交换是通过定义帧或者包为单位的,一个 transaction 就是一个于 CAN 总线控制器逻辑电路进行通信的时候,数据以信号的形式打入 CAN_D中。transaction 部分设计代码如下,其中 frame_format 是帧的格式(标准模式或展模式),frame_type 是帧的类型(数据帧、远程帧、错误帧),ID 是 29 位的标,data 表示 8 位数据,而 data_size 表示数据大小,crc 校验码为 15 位。
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