基于DSP的信息处理实验平台设计

发布时间：2020-07-29 21:02

【摘要】： 本文通过分析数字信号处理器综合系统的需求，设计并实现了基于DSP+CPLD新型体系结构的数字信号处理器综合实验平台。在该平台上采用了模块化设计思想，进行了硬件系统核心模块(DSP)、控制器模块(CPLD)、存储器模块、点阵图形式液晶显示模块、语音处理模块、网络控制模块、自举加载引导模块以及可编程逻辑器件等具体电路设计及实现，并完成硬件调试试。软件方面，进行了相应的算法研究，对FLASH非易失性存贮器、语音处理模块音频采集和液晶显示部分驱动程序进行编程设计，并分析了网络协议TCP／IP协议族中的各层协议和各层之间的数据传输、PC机与系统之间的数据传输服务，同时分析了单片机与DSP主机接口模式自启动引导方法及设计实现方案。
【学位授予单位】：长春理工大学
【学位级别】：硕士
【学位授予年份】：2007
【分类号】：TN911.72;TP368.1
【图文】：

图3.3TMS320vC5409存储器组织图.3.2DSP与地址分配相关引脚DSP与地址分配和访问有关的管脚l粉灵多，按功能分为如下四1、并行地址线TMS320VC54Og的程序区的最大寻址空间为SM字范围，数据FO空间的地址范围为64K字。TMS320VC54Og芯片提供并行的地，从A22(最高位)到AO(最低位);低位16根地址线(AO一A1用地址线;高7位地址(A16一A22)为程序空间扩展地址线，专扩展程序区的寻址。2、并行数据线TMS320VC5409芯片提供并行双向数据总线，从D15(高位)(低位)。3、选通信号DSP提供三个基本的地址空间选择的控制信号PS、DS、IS，是程序空间选通、数据空间选通和UO空间选通这三个信号为

在电路原理设计时，为了能灵活地对存储器读写进行控制，而把存储器AS29LV400B、IC61LV6416所有控制引脚均由CPLD进行编程控制。存储器与DSP硬件接口原理电路设计，如图3.4所示。

是由单片机时钟输出产生，并经过外部CPLD电平转换后向芯片来提供的。语音A了D、D/A芯片与DSP芯片TMS32OVC54Og多通道缓冲同步串行口McBSP的硬件电路设计原理图，如图3.5所示。

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本文编号：2774492