USB2.0PHY IP验证系统逻辑设计与实现

发布时间：2020-09-08 18:02

　　 通用串行总线(USB)作为新一代的标准总线接口,不仅能够同时连接多达127个设备,而且具有快速、即插即用等特点,使外设到主机的连接更加高效和便利。由于USB总线的众多优点,研究和设计传输速度更快、性能更可靠稳定的USB接口是当今的发展趋势之一。但是,国内集成电路设计技术的落后导致了国外接口芯片对于国内市场的垄断,因此,提供更高性价比的产品成为了国内IC设计公司自主研发USB2.0接口芯片的动力。在当前的SoC设计中,验证工作占了整个设计工作的70%左右。完善验证系统,提高验证质量和效率,缩短芯片开发时间将是今后IC设计不可忽视的关键所在。 本文根据承担项目的需求,针对USB2.0PHY IP,在详细确定各个模块功能的基础上,采用了自顶向下的模块化逻辑设计方案,完成了该系统总体设计方案以及高速数据传输逻辑设计的具体实现。论文研究了USB2.0的特性、IP核的基本概念以及功能验证的基本方法等,在充分理解了USB2.0协议以及UTMI规范的基础上,对验证系统硬件平台的各个芯片的工作原理和工作时序进行了深入分析,确定了验证系统在高速模式下的逻辑设计方案,并采用硬件描述语言对各功能模块逻辑进行RTL级(即寄存器传输级)描述,最后使用ISE仿真器完成了仿真、综合及调试,最终成功地用于对USB2.0PHY IP硬核的高速功能及可靠性验证上。
【学位单位】：西安电子科技大学
【学位级别】：硕士
【学位年份】：2010
【中图分类】：TP334.7

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本文编号：2814462