双CPU结构捷联导航数据处理系统硬件设计

发布时间：2021-02-06 21:45

　　本文主要研究了一种基于高性能浮点DSP（TMS320C6713）和十六位单片机（SPCE061A）的双CPU结构的捷联导航数据处理系统。该系统双CPU分工协作，充分的发挥了该型DSP对浮点数据的处理精度高、速度快的能力并且还利用单片机控制能力强的特点，有效的弥补了DSP接口少、控制弱的缺点，使得系统可以同时进行采集和处理数据。该方案既在提高性能的同时还节约了成本，减少了体积，降低了功耗，完全符合新一代捷联导航系统方案的性能指标。文中结合现代导航技术发展的特点和导航计算机系统的实际需求，详细阐述了捷联导航计算机硬件设计的主要设计思想，经过分析研究和选型，设计了捷联导航计算机系统的总体方案和硬件电路。本系统设计采用DSP+单片机的双CPU体系结构方案，DSP主要负责数据的处理，单片机主要负责信号采集和系统的输入输出控制，两者结合实现优势互补，充分发挥各自的特长。此外，如何解决好DSP与单片机的接口与数据通讯问题是设计DSP与单片机双CPU控制系统的关键。经过分析论证，本文提出了一种结构简单、成本低且易于实现的双机通信方法。系统中，DSP通过HPI接口和单片机实现数据通讯，获取单片机采集的数... 

【文章来源】：哈尔滨工程大学黑龙江省 211工程院校

【文章页数】：108 页

【学位级别】：硕士

【部分图文】：

TMS32OC6713B的片内2级高速缓存结构图

哈尔滨工程大学硕士学位论文②SetuP+Strobe+Hold之tr。(m)/p③HoldZ(th一toh(m))/p.FLASH写时序设计(3一2)(3一3)FLASH的写时序图见图3.12。同样对照图3.12的时序示例，写操作中SETUP，STROBE，HOLD三个参数可以依照下面的条件来确定:①Strobe之偏(m)/p(3一4)②Set即+Strobe全txw(m)/p(3一5)③HoldZ[MAX(tih，twT(m))](3一6)④Set即+Strobe+Hold全twc(m)/p(3一7)3.1.4电源设计本系统所要用到的电源有:巧V、+3.3v、+1.2V，其中+3.3V和+l.2v电源

哈尔滨工程大学硕士学位论文源设计的原理图见图3.13。3.1.5时钟设计TMS320C6713B的时钟方式有2种:一种是由外部直接输入，另一种是在外部接上一定的辅助电路由DSP振荡器产生系统时钟。芯片的主频参数由寄存器PLLCSR、PLLM、PLLDVx和OSCD工V1配置。出于简化系统设计本系统中采用了现成的外部时钟电路产生系统时钟直接输入到DSP，其电路原理图如下(见图3.14)。

【参考文献】：
期刊论文
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本文编号：3021141