基于标志编码的指令Cache低功耗方法

发布时间：2018-01-08 15:32

  本文关键词：基于标志编码的指令Cache低功耗方法　出处：《微电子学与计算机》2016年12期 　论文类型：期刊论文

  更多相关文章： 标志编码 低功耗 指令Cache 嵌入式处理器

【摘要】：针对嵌入式处理器中指令Cache功耗显著的问题,提出了一种基于标志编码的低功耗指令Cache设计方法.通过增加一个容量很小的标志缓冲器来保存内核地址中的标志位,并利用位宽较小的标志编码存储器取代传统指令Cache结构中位宽较大的标志存储器来存储标志缓冲器中每一行对应的编码数据,减小了指令Cache的面积,从而降低了每次访问指令Cache的功耗.实验结果表明,本文提出的指令Cache结构相比传统指令Cache结构功耗降低了11.76%,面积减小了10.04%.
[Abstract]:Aiming at the problem of instruction in embedded processor Cache power consumption significantly, this paper puts forward a design method of low power consumption based on Cache instruction encoding. The signs increase the capacity of a small buffer to save flag bits in the kernel address, and use the symbol encoding memory bit smaller for each row of data to replace the traditional instruction bit encoding Cache in the structure of the larger flag symbol memory to store the buffer, reduces the instruction Cache area, thereby reducing the power consumption of each access instruction Cache. The experimental results show that the proposed Cache instruction structure compared with the traditional instruction Cache structure to reduce the power consumption by 11.76%, the area is reduced by 10.04%.

【作者单位】： 中国电子科技集团公司第三十八研究所;
【基金】：国家“核高基”重大专项(2012ZX01034001-001)
【分类号】：TP332;TP333
【正文快照】： 1引言在目前嵌入式处理器的设计中,功耗已经成为了一个非常重要的指标[1].片上指令Cache作为弥合处理器内核与主存之间速度差距的关键部件,由于具有很大的面积和很高的访问频率而功耗显著,如Strong-ARM SA110处理器中有27%的功耗来自于片上指令Cache[2].因此,降低片上指令Cach

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本文编号：1397698