AHB Matrix互连总线IP的设计与实现
本文关键词: AHB AHB Matrix AHB-Lite 互连总线 出处:《微电子学与计算机》2015年10期 论文类型:期刊论文
【摘要】:结合一款基于MIPS14K内核的SoC中AHB总线矩阵的设计需求,分析单层AHB总线的特性及不足,提出并实现了一种可配置、层次化、高效的AHB总线矩阵体系架构.该总线矩阵符合AHB lite协议标准,支持多路MASTER/SLAVE并行访问,减小了总线仲裁延迟,提高了系统带宽,应用高效的轮询仲裁机制,提高嵌入式SoC芯片的整体性能.本设计实现了5主5从的AHB总线矩阵,已应用于一款SMIC55nm工艺条件下工作频率为160MHz的轻量级嵌入式网络处理器SoC芯片,完成FPGA系统级验证并实现了流片设计.
[Abstract]:This paper analyzes the characteristics and disadvantages of the single - layer ahb bus by combining the design requirements of an ahb bus matrix in soc based on mimi14k kernel , and proposes and implements a configurable , hierarchical and efficient architecture of ahb bus matrix system .
【作者单位】: 中国科学院微电子研究所;
【基金】:国家重大专项(2013ZX03004007-004) 北京科技新星计划(201B060)
【分类号】:TP336
【正文快照】: 1引言AHB总线作为AMBA 2.0规范之中的一个重要组成部分,是实现CPU、DMA等高性能设备之间互连所必不可少的模块.但是,随着SoC复杂度地提高,总线设备数量以及速度地快速增长,传统AHB总线难以满足高速设备对吞吐率、总线访问延迟的需求.各个IP以及IO设备与存储器之间通讯的增多,
【参考文献】
相关期刊论文 前2条
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【共引文献】
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相关博士学位论文 前2条
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【二级参考文献】
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,本文编号:1473703
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