抗干扰数据电能校验调度嵌入式系统设计

发布时间：2018-04-02 13:17

  本文选题：嵌入式系统　切入点：抗干扰数据　出处：《科技通报》2015年04期

【摘要】：提出一种基于S3C6410A的抗干扰数据电能校验调度嵌入式系统的设计,通过抗干扰数据的检测,对检测参数进行数据电能校验调度,建立一个基于S3C6410A抗干扰核心处理器与嵌入式操作系统的设计平台,利用高效能的方法检测干扰数据,通过对抗干扰数据的分析,并进行电能校验调度,建立嵌入式系统设计程序,完成对其数据参数进行分析的过程。仿真实验表明,基于S3C6410A的抗干扰数据电能校验调度嵌入式系统能够通过定义抗干扰数据模型来实现对旧方法的改变,且可灵活增加或删除相应验证的能力,满足嵌入式系统设计模型重复验证和评估的要求,从而得到更为高性能、低功耗、低成本的抗干扰数据电能校验调度嵌入式系统,促进了嵌入式系统设计方法的新发展。
[Abstract]:In this paper, an embedded system of anti-interference data check and dispatch based on S3C6410A is proposed. Through the detection of anti-interference data, the test parameters are checked and scheduled. A design platform based on S3C6410A anti-jamming core processor and embedded operating system is established. The interference data is detected by high-efficiency method. Through the analysis of anti-interference data, the power power check and scheduling is carried out. The design program of embedded system is established, and the process of analyzing its data parameters is completed. The simulation results show that, The anti-jamming data power check and dispatch embedded system based on S3C6410A can change the old method by defining the anti-jamming data model, and can flexibly increase or delete the ability of corresponding verification. It can meet the requirements of repeated verification and evaluation of embedded system design model, so as to obtain higher performance, lower power consumption and lower cost of anti-interference data power check and scheduling embedded system, which promotes the new development of embedded system design method.
【作者单位】： 福建工程学院信息科学与工程学院;
【分类号】：TP368.1

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本文编号：1700561