面向内存的混合容错编码动态调节设计

发布时间：2018-04-19 10:42

  本文选题：内存系统 + 可靠性　； 参考：《计算机辅助设计与图形学学报》2014年09期

【摘要】：针对内存系统中高强度的容错编码容易造成过大开销的问题,为同时实现容错强度和容错开销的权衡,提出一种低开销的支持混合容错编码的动态调节设计.通过分析发现常见纠错检错编码数据位长与校验位长存在固定的比例关系,提出一种地址映射逻辑电路;当系统存取内存数据及容错强度发生调节时,该方法可保证容错编码中校验信息的存取,实现对内存容错强度调节以及数据与校验信息在内存中分开存储的支持.实验结果表明,文中设计简单,硬件和性能代价小、功耗开销低.
[Abstract]:Aiming at the problem that high intensity fault-tolerant coding in memory system can easily cause excessive overhead, a low-overhead dynamic adjustment design supporting hybrid fault-tolerant coding is proposed to realize the trade-off between fault-tolerant intensity and fault-tolerant overhead.By analyzing the common error correction code data bit length and checking bit length in a fixed proportion, an address mapping logic circuit is proposed, when the system accesses memory data and the fault-tolerant intensity is adjusted,This method can guarantee the access of the check information in the fault-tolerant coding, and realize the support of adjusting the fault-tolerant strength of the memory and storing the data and the check information separately in the memory.The experimental results show that the design is simple, the cost of hardware and performance is low, and the cost of power consumption is low.
【作者单位】： 计算机体系结构国家重点实验室;中国科学院计算技术研究所;中国科学院大学;
【基金】：国家自然科学基金项目(61076018,61274030) 国家“九七三”重点基础研究计划基金项目(2011CB302503) 中国科学院计算技术研究所-华为联合实验室项目(YBCB2011030)
【分类号】：TP302.8

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本文编号：1772760