1553B总线通信终端知识产权核的设计

发布时间：2018-05-29 21:17

  本文选题：B总线 + 通信终端　； 参考：《计算机应用》2014年03期

【摘要】：为满足航天飞行器地面仿真设备使用的需求,设计了一种基于可编程逻辑门阵列(FPGA)的1553B总线通信终端知识产权(IP)核。在保证总线系统可靠性的前提下,采用自顶向下的设计方法与"双进程"编码方式,利用超高速硬件描述语言(VHDL)生成目标代码,使用ModelSim软件进行仿真,最后在实际设备中验证并应用。该IP核可配置在总线控制器、远程终端或总线监控器3种不同的工作模式下运行,易于集成入片上系统(SoC),对进一步应用1553B总线提供了更多的选择。
[Abstract]:A 1553B bus communication terminal IP core based on programmable logic gate array (FPGA) is designed to meet the requirements of ground simulation equipment for aerospace vehicles. Under the premise of ensuring the reliability of the bus system, the top-down design method and "double process" coding method are used to generate the target code by using the ultra-high speed hardware description language (VHDL), and the simulation is carried out by using ModelSim software. Finally, it is verified and applied in the actual equipment. The IP core can be configured to operate in three different working modes: bus controller, remote terminal or bus monitor. It is easy to be integrated into the on-chip system and provides more options for further application of 1553B bus.
【作者单位】： 中国科学技术大学软件学院;首都师范大学信息工程学院;
【分类号】：TP336

【参考文献】

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【共引文献】

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【二级参考文献】

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2 胡s，

本文编号：1952391