基于Cadence的DDR2串扰研究与仿真

发布时间：2018-06-02 09:33

  本文选题：串扰 + 近端串扰　； 参考：《浙江工业大学学报》2016年03期

【摘要】：随着系统的工作频率及信号边沿转换速率的不断提高,串扰对于信号完整性的影响日益突出.通过对传输线串扰形成机理的分析,使用Cadence仿真软件对系统中的DDR2SDRAM的数据线进行串扰仿真,给出了合理处理串扰问题的解决方案.对于数据线的近端串扰和远端串扰仿真分析,在理论及仿真结果的基础上,可以通过减小耦合线长度、增大耦合线间距和减小反射等方法降低串扰对于电路的影响.笔者提出了PCB设计中抑制串扰的一些有效措施,对于DDR2SDRAM的信号完整性设计有一定的指导意义.
[Abstract]:With the increasing of the operating frequency and the signal edge conversion rate, crosstalk has more and more influence on the signal integrity. Based on the analysis of the formation mechanism of transmission line crosstalk, the Cadence simulation software is used to simulate the crosstalk of DDR2SDRAM data lines in the system, and the solution to the crosstalk problem is given. Based on the theoretical and simulation results, the influence of crosstalk on circuits can be reduced by reducing the length of coupling lines, increasing the spacing of coupling lines and reducing reflection. In this paper, some effective measures to suppress crosstalk in PCB design are put forward, which can be used to guide the signal integrity design of DDR2SDRAM.
【作者单位】： 浙江工业大学信息工程学院;
【分类号】：TP333

【参考文献】

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【共引文献】

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本文编号：1968278