基于FPGA的通用SPI总线IP核设计与实现
[Abstract]:In order to solve the universal problem of serial clock in SPI protocol, a design method of SPI bus IP core based on FPGA is proposed. The system structure is decomposed by modularization with FPGA as the core controller to adapt to the top-down design method and each module is described. The design method of SPI host is realized by using Verilog hardware description language and finite state machine in Quartus II development platform, and the corresponding mathematical model is given in combination with SPI timing. The system scheme is designed with M25P64 serial FLASH of STMicro company and the IP core. Finally, the read and write operations of FLASH are simulated under the Modelsim environment, and the correctness and reliability of the IP core design are verified by the online test of signaltap.
【作者单位】: 地质灾害防治与地质环境保护国家重点实验室 成都理工大学;西南科技大学;
【基金】:国家自然科学基金重大科研仪器设备研制专项(41227802) 国家杰出青年科学基金(41025015) 国家自然科学基金(41274109) 四川省青年科技创新研究团队项目(2011JTD0013) 四川省科技支撑计划(2013FZ0022)
【分类号】:TP336
【参考文献】
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【共引文献】
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,本文编号:2215381
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