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基于可逆触发器的可逆移位寄存器设计方法

发布时间:2019-01-12 07:56
【摘要】:为了进一步提高可逆时序逻辑电路设计方法的通用性和改善可逆电路性能指标,以可逆主从D触发器为基本单元,通过将时钟信号及垃圾位信号级联再利用,提出了一种可逆串行移位寄存器优化设计方案。在此基础上,通过目标函数构造及变换构建带有移位控制的单元模块,设计了满足串行输入串/并行输出功能的n位可逆双向移位寄存器。设计结果表明,采用方法所设计的可逆移位寄存器具有较优的性能指标,且对于双向移位寄存器综合具有较好的通用性。
[Abstract]:In order to further improve the generality of reversible sequential logic circuit design method and improve the performance index of reversible circuit, the reversible master-slave D flip-flop is taken as the basic unit, and the clock signal and garbage bit signal are cascaded and reused. An optimal design scheme of reversible serial shift register is proposed. On this basis, an n-bit reversible bidirectional shift register with serial input string / parallel output function is designed by constructing and transforming the unit module with shift control. The design results show that the reversible shift register designed by the method has better performance index and better generality for bidirectional shift register synthesis.
【作者单位】: 南京航空航天大学自动化学院;
【基金】:航空科学基金(2013ZD52055)资助项目
【分类号】:TP332.11

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本文编号:2407531

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