基于嵌入式处理器的无线信息公告屏的研发
【学位单位】:杭州电子科技大学
【学位级别】:硕士
【学位年份】:2011
【中图分类】:TP368.12;TN873.93
【部分图文】:
图3.1PXA27O处理器内部结构框图3.1.2嵌入式微处理器核心板电路设计结构PXA27O的芯片封装为PBGA,其底部引脚数为360个,0.65Inm的焊球间距,密度相当高,所以低层数PCB(PrintedCircultBoard)线路板无法满足嵌入式平台核心板电路的布线要求,因此,本系统采用的是六层板布线技术实现处理器核心板的设计,将处理器必要的一些外设引脚输出至两根1.27mm间距的2x50芯的标准排针,包括JTAG接口,电源输入,数据总线和地址总线,以及多个串口,SPI接口,普通GPIO等。这样将核心板独立于其他外设电路,极大地增强了硬件平台的可移植性和通用性。图3.2为无线信息公告屏核心板的整体布局。核心板电路布局比较集中,面积较小,这样既降低了制板成本,也便于整个系统的集成。将必要的一些核心电路集中到了一块核心板上,极大地方便了产品的设计和开发调试,同时,在某些有强电磁千扰的应用电路中,可以通过使核心板远离干扰源而增加整个电路的设计可靠性。
一些外设引脚输出至两根1.27mm间距的2x50芯的标准排针,包括JTAG接口,电源输入,数据总线和地址总线,以及多个串口,SPI接口,普通GPIO等。这样将核心板独立于其他外设电路,极大地增强了硬件平台的可移植性和通用性。图3.2为无线信息公告屏核心板的整体布局。核心板电路布局比较集中,面积较小,这样既降低了制板成本,也便于整个系统的集成。将必要的一些核心电路集中到了一块核心板上,极大地方便了产品的设计和开发调试
杭州电子科技大学硕士学位论文地址线BAO和BA一。地址总线MA〔10一22」对应于sD似M的Ao一A12,nSDCASRAS分别接SDRAM的CAS和RAS引脚,进行SDRAM寻址时PXA27O硬件自动nsDeAs和nsDRAS的值对行列进行寻址,DQM[o一l」连接SDRAMUDQM和LDQM六六和和和和和A一1幻阅阅阅阅
【参考文献】
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本文编号:2842547
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