基于ARM嵌入式平台的X86译码SoC架构设计
【部分图文】：
用支持基于寄存器访问的低速设备。AHB与APB两条总线通过总线桥连接在一起,实现两条总线之间的协议转换。图1为SoC的系统结构框图。图1 SoC系统架构1.3 各IP在系统中的功能除了两个处理器外,SoC中各IP核功能如下:翻译模块:实现将X86指令翻译成为ARM指令的功能。SMI:外部存储与微处理器之间的桥梁,支持ROM作为系统的非易失性存储介质,支持片外SRAM作为系统的外围高速存储。中断控制器:用来支持系统内部与外部的中断控制,如中断电平/边沿触发、中断电平极性与中断使能等。Internal Memory:片内SRAM,大小为1 KB,但可以通过修改Verilog的描述来改变其大小。Default Slave:用于当master访问未定义的地址空间时,给出一个应答信号。Retry Slave:是一个可以产生重试回应及等待命令的slave范例
有些Slave只有在特殊情况下才被访问,因此可以将多个Slave看作一个Slave挂在BusMatrix上。优化后的SoC硬件架构如图4所示。图4 优化的SoC架构4 结 语这里给出了一种具有X86到ARM二进制翻译和执行功能的SoC系统。利用Multi-layer bus switch(BusMatrix)模块实现Multi-layer总线结构,在多个核不访问同一个Slave时,可以同时执行各自功能,有效提高系统的性能,且该总线结构的可扩展性强。同时根据系统工作的特点,对总线结构进行了优化,减小了总线的复杂度。参 考 文 献[1] Cifuentes C,Malhotra V.Binary Translation:Static
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本文编号：2859179
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