基于协议控制器的DDR3访存控制器的设计及优化

发布时间：2017-08-20 06:32

  本文关键词：基于协议控制器的DDR3访存控制器的设计及优化

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【摘要】：为了完成SoC系统中片外DDR3存储器高效访问,实现了基于协议控制器的DDR3访存控制器.针对SoC系统层访问事务属性与DDR3存储器突发访问属性要求之间的不匹配问题,设计了一种访问请求平滑处理机制,充分利用协议控制器的DDR3访问命令缓冲,用更少的DDR3存储器访问请求完成SoC上层读写事务,提高了整个DDR3访存控制器的访问效率.采用Verilog语言完成了逻辑设计和物理实现,并采用人工综合激励的方法对访问请求平滑机制进行了评估,实验证明该优化机制可对DDR3访存控制器实现有效加速.
【作者单位】： 国防科学技术大学计算机学院;
【关键词】： DDR 访存控制 请求平滑
【基金】：国家自然科学基金项目(61402500)
【分类号】：TP333
【正文快照】： 1引言DDR3SDRAM[1](下文简称DDR3)是SoC系统中常用的一种片外存储器[2],其主要优点是成本低、集成度高、容量大、速率快、峰值带宽高.DDR3在较高的频率下采用源同步的并行总线传输信号,这对时序和信号完整性的要求极高.因此,SoC系统直接集成专用的DDR3协议控制器(包含协议层控

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本文编号：705102