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481. 基于0.18μm
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工艺的高速高精度采样保持电路的研究与设计
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483. 标准
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484. 基于130nm
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485. 应用于CEPC顶点探测器芯片JadePi×3中集成
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电荷泵锁相环的设计
486. 40nm
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25Gb/s无参考时钟全速率CDR集成电路的研究与设计
487. 基于0.18μm
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工艺的高速前馈均衡器的设计及数字锁相环的研究
488. 0.18μm
CMOS
6.25Gb/s自适应判决反馈均衡器的研究与设计
489. 基于印刷碳纳米管和金属氧化物薄膜晶体管的杂化
CMOS
反相器的构建及电性能研究
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