一种基于FPGA的抗辐射加固星载ASIC设计方法

发布时间：2017-12-17 13:31

  本文关键词：一种基于FPGA的抗辐射加固星载ASIC设计方法

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【摘要】：针对静态随机存储器(SRAM)型现场可编程门阵列(FPGA)空间应用的问题,提出了基于FPGA星载抗辐射加固专用集成电路(ASIC)设计的全流程,并重点对扫描链设计、存储器内建自测试、自动向量生成、ASIC封装设计、散热设计、加电振动试验等关键点的设计方法和注意事项进行了介绍。通过设计、测试、封装、试验,实现了基于静态随机存储器型FPGA转化为抗辐射加固ASIC。ASIC抗辐射总剂量大于100krad(Si),抗单粒子闩锁(SEL)阈值大于75 MeV·cm~2/mg,抗单粒子翻转(SEU)阈值大于22 MeV·cm~2/mg,满足空间应用的要求,具有很好的应用前景。
【作者单位】： 中国卫星导航系统管理办公室;北京空间飞行器总体设计部;
【分类号】：V446
【正文快照】： 1引言近年来,随着用户对提高卫星功能和性能要求的急迫增长,卫星系统对星载电子产品提出了集成度高、质量轻、体积小、功耗低等一系列要求,静态随机存储器(Static Random Acess Memorizer,SRAM)型现场可编程门阵列(FPGA)由于其集成度高、资源丰富、设计灵活、易于修改等特点在

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